DC-DC降压芯片是否有输入输出压差范围要求？

在LDO应用中，会有一个输入输出压差范围的概念，如AMS1117，压差Dropout Voltage的典型值为1.1V，即：输入至少比输出高1.1V的压降才能支持所需要的输出。

首先，根据能量守恒，我们可知(Vin-Vout)*ton=Vout*toff，由此

Vout = Vin * D，D为开关周期中，“开”的占空比。

考虑，MOS管导通内阻Rds、电感内阻RL，可得：

Vout = Vin * D- Iout x (Rds(ON) + RL)

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由此可知，此时该当输入为4.0V的时候，JW5092无法满载输出3.3V/2A

所以DC-DC降压电路中，实际输出电压要等于输入电压减去Buck芯片里集成或外置的MOSFET的Rds(on)以及输出电感的Rdc上产生的压降，包括由于占空比受限导致的无法满载输出。带载越重，输出电压越低。当你的输入输出压差范围很小，但仍然需要满载输出时，请考虑 称可达100%占空比的芯片！

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